Centro de suporte para IP de interfaces de memória externa

A página de suporte da interface de memória externa (EMIF) oferece processo de projeto do início ao fim para FPGAs.

Introdução

O centro de suporte da interface de memória externa (EMIF) oferece recursos para dispositivos Agilex™ 7, Agilex™ 5, Agilex™ 3, Stratix® 10, Arria® 10 e Cyclone® 10.

Você encontrará informações sobre como planejar, projetar, implementar e verificar suas interfaces de memória externa. Você também encontrará depuração, treinamento e outros materiais de recursos nesta página.

Obtenha suporte adicional para o projeto de protocolo de interface FPGA Agilex™ 7 e o projeto de protocolo de interface FPGA Agilex™ 5. Essas jornadas guiadas passo a passo para fluxos de desenvolvimento padrão superam os principais recursos críticos e documentação.

Para outros dispositivos, pesquise nas Coleções de Suporte de Dispositivos e Produtos.

1. Seleção de dispositivos

Como selecionar um dispositivo

Estão disponíveis duas ferramentas para ajudá-lo a selecionar um FPGA de acordo com os requisitos da memória:

Seletor de Dispositivos EMIF

Estimador de especificações EMIF

Características
  • Determina as interfaces de memória necessárias para obter uma largura de banda desejada
  • Calcula a largura de banda com base nas configurações de memória selecionadas
  • Exibe todas as interfaces de memória Agilex™ 7, Stratix® 10 e Arria® 10 FPGAs compatíveis com as interfaces de memória selecionadas
  • Determina o desempenho alcançado para a configuração específica da família de dispositivos FPGA selecionadas
  • Exibe frequência máxima para cada família FPGA, nível de velocidade e configuração EMIF com base em seleções de filtro
  • Encontre e compare o desempenho de cada interface e configurações de memória externa suportadas para nosso FPGAs

Suporte de dispositivos
  • FPGAs Agilex™ 7
  • Stratix® 10 FPGAs
  • Arria® 10 FPGAs
  • Todas as FPGAs

Recursos

Ferramentas EMIF
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Como selecionar uma propriedade intelectual (IP) de memória externa

Para saber mais sobre as diversas propriedades intelectuais (IP) de memória disponíveis, consulte o seguinte currículo de treinamento online:

Estágio

 Dispositivos suportados

Descrição
Introdução às interfaces de memória

Agilex™ 7

Séries F e I

 Este treinamento é a parte 1 de 4. Esta primeira parte do treinamento apresenta as opções de memória disponíveis e descreve como a arquitetura desses dispositivos torna tal desempenho possível. Treinamentos adicionais na série são Integração de Interfaces de Memória (parte 2) e Verificação de interfaces de memória (parte 3) e depuração em chip (parte 4)

Introdução ao IP de interfaces de memória em dispositivos FPGA

 Agilex™ 5

Este curso abrange as diferentes opções de interface de memória externa disponíveis, bem como os recursos de arquitetura e controlador de memória física para Stratix® 10 e Arria® 10 FPGAs.
Memória DDR5 e o IP de interface de memória Agilex™ 5 Este treinamento inclui uma gravação do "DDR5 Memory and the Memory Interface IP Ask an Expert". Nesta sessão, os engenheiros da FPGA Apps discutem a tecnologia de memória DDR5 e respondem a perguntas sobre DDR5 e o IP da interface de memória.

Interfaces de memória de alta largura de banda (HBM2): introdução, arquitetura

 Stratix® 10 MX

Este curso aborda os benefícios de integrar a alta largura de banda de memória aos dispositivos FPGA Stratix® 10 MX FPGA, recursos e opções para o controlador HBM reforçado, e como gerar o HBM2 IP.

Interfaces de memória de alta largura de banda (HBM2) em: recursos hbmc

 Stratix® 10 MX

Este curso aborda os recursos e opções do controlador HBM reforçada, e a interface AXI Arm* AMBA 4 entre o controlador e a lógica do usuário.
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2. Guias do usuário e documentação

Como encontrar informações sobre o IP EMIF

Para obter informações sobre a Propriedade Intelectual (IP) da Interface de Memória Externa (EMIF), consulte os seguintes Guias de usuário IP das interfaces de memória externa:

  • Consulte a seção "Guias do usuário"
Dispositivo dispositivo
Tipo de conteúdo

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

Agilex™ 5 Agilex™ 3Stratix® 10 dispositivoArria® 10 dispositivoCyclone® 10
Guia do usuário do IP
Guia do usuário do exemplo de projeto
-
FPGA guia do usuário do PHY Lite -
guia do usuário FPGA HBM2 - - - - - -
Notas da versão
Arquivos de pin-out
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3. Geração do EMIF IP

Como gerar o IP EMIF

Para informações detalhadas sobre os parâmetros de propriedade intelectual (IP) da interface de memória externa (EMIF), consulte as seguintes seções específicas do protocolo nos seguintes Guias do usuário emIF IP:

Tópico

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

 Dispositivo Agilex™ 5

Stratix® 10 dispositivo

Arria® 10 dispositivo

Cyclone® 10 dispositivo

Descrições de parâmetros EMIF IP

Nota: para obter mais informações sobre como gerar o IP EMIF, consulte as seções de Guias de usuário e cursos de treinamento e vídeos abaixo.
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Como realizar simulação funcional

do
Tópico

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

 Dispositivo Stratix® 10dispositivo Agilex™ 5Stratix® dispositivo Arria® 10 MXCyclone® 10 dispositivo
Simulando os guias do usuário da interface de memória externa

Simulando IP de memória

Simulando IP de memória

Simulando IP de memória

Simulando IP de memória

Simulando HBM2 IP

Simulando IP de memória

 Simulando IP de memória
Gerando um guia do usuário de exemplos de projeto de simulação EMIF Exemplo de projeto para simulação Exemplo de projeto para simulação Exemplo de projeto para simulação Exemplo de projeto para simulação Exemplo de projeto para simulação Exemplo de projeto para simulação Exemplo de projeto para simulação
Nota: para obter informações sobre como verificar um projeto EMIF, consulte a seção "Cursos de treinamento e vídeo" para o curso "Verificar interfaces de memória IP".
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Onde encontrar informações sobre FPGA posicionamento de pinos e recursos

Para informações detalhadas sobre pinos de interface de memória externa (EMIF), consulte as seguintes seções específicas do protocolo nos seguintes guias do usuário de propriedade intelectual (IP) EMIF:

Tópico

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

 Dispositivo Agilex™ 5

Stratix® 10 dispositivo

Arria® 10 dispositivo

Cyclone® 10 dispositivo

Planejamento de pinos e recursos EMIF
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Planejador de interface

Para obter informações sobre o Planejador de interface para designações de localização de recursos, consulte o seguinte treinamento on-line.

Estágio

Descrição

Projeto de sistema de E/S rápido e fácil com Planejador de interface

Este curso abrange como implementar uma planta útil de recursos de projeto usando o Planejador de interface. Saiba mais sobre o Planejador de interface, anteriormente conhecido como BluePrint, uma ferramenta fácil de usar no software Quartus® Prime Pro Edition que usa a potência do Fitter para criar uma planta baixa legal em minutos.

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Recursos adicionais para PHY Lite para interfaces paralelas

Descrição de dispositivo suportada por tópico
Guia do usuário do PHY Lite para interfaces paralelas FPGA IP
  • FPGA Agilex™ 7 série F, série I e série M
  • FPGA Agilex™ 5 sérieS D e E
  • Agilex™ 3 FPGA série C
  • Stratix® 10 FPGA
  • Arria® 10 FPGA
  • Cyclone® 10 GX FPGA
 O uso principal do PHY Lite para IPs de interfaces paralelas é usado para a construção de blocos PHY de interface de memória personalizada. Consulte este guia do usuário para obter instruções de interface com protocolos como DDR2, LPDDR2, LPDDR, TCAM, Flash, ONFI (modo síncrono) e DDR móvel. O PHY Lite para interfaces paralelas FPGA IP é adequado para interfaces paralelas simples.
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4. Projeto e simulação de placa

Onde encontrar informações sobre layout e design de placas

Para informações detalhadas sobre layout de placa de interface de memória externa (EMIF), consulte as seguintes seções específicas do protocolo nos seguintes guias de usuário de propriedade intelectual (IP) EMIF:

Tópico

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

 Dispositivo Agilex™ 5

Stratix® 10 dispositivo

Arria® 10 dispositivo

Cyclone® 10 dispositivo

Diretrizes de projeto de placa EMIF
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Como executar simulação de placa/canal

Para obter informações sobre a medição de interferência Intersymbol (ISI) e interferência de gravação e leitura, organização de comando, endereço, controle e pinos de dados e restrições de posicionamento do banco de E/S, consulte as seguintes diretrizes:

Como calcular a distorção da placa e a perda do canal

Duas ferramentas estão disponíveis para ajudá-lo a calcular a distorção da placa e a perda do canal:

Tópico

Ferramenta de parâmetro de inclinação da placa

Ferramenta de cálculo de perda de canal

Características
  • Calcula a distorção da placa devido a traços de PCB e projetos multinível
  • Calcula a perda de canal devido à interferência Intersymbol (ISI) e diafonia em sinais de comando, endereço, controle e dados

Apoio
  • Arria® FPGAs 10 e Stratix® 10 Stratix®
  • Todos os protocolos de memória
  • Arria® FPGAs 10 e Stratix® 10 Stratix®
  • Protocolos de memória DDR
  • Compatível apenas com o Software de integridade de sinal Mentor Graphics HyperLynx

Ferramentas
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Onde encontrar informações sobre o fechamento de cronometragem

Para obter informações sobre o fechamento de temporização da Interface de Memória Externa (EMIF), consulte a seção a seguir nos Guias do usuário de propriedade intelectual (IP) EMIF.

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

 Dispositivo Agilex™ 5

Stratix® 10 dispositivo

Arria® 10 dispositivo

Cyclone® 10 dispositivo
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5. Depuração

Como depurar projetos de interface de memória externa

Para obter informações sobre a depuração da propriedade intelectual (IP) de interface de memória externa (EMIF), consulte a seção a seguir nos Guias do usuário emIF IP.

Dispositivo
Agilex™ 7 Agilex™ 5Stratix® 10 dispositivoArria® 10 dispositivoCyclone® 10 dispositivo
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Como usar o kit de ferramentas de depuração EMIF

Estágio

Descrição

Kit de ferramentas EMIF e kit de ferramentas de depuração em chip de IP de interfaces de memória em dispositivos FPGA

Este curso aborda como executar a depuração usando o kit de ferramentas EMIF ou o kit de ferramentas de depuração on-chip, como usar o Traffic Generator 2.0 e configurar vários projetos de interface de memória para compatibilidade com essas ferramentas de depuração.
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Descrição dos recursos, suporte e acessibilidade do kit de ferramentas de depuração EMIF:

Características
  • Exibe margens de pré e pós-calibração por grupo DQS e pino DQ
  • Gera diagramas de olho de leitura/gravação por pino DQ (diagrama de olho 2D)
  • Permite gerador de tráfego em tempo real personalizável para teste/depuração (Gerador de tráfego 2.0)
  • Captura margens de leitura/gravação durante o tráfego no modo do usuário (Margining do driver)

Apoio
  • Compatível com projetos de exemplo de projeto EMIF e projetos EMIF personalizados contendo uma ou mais interfaces de memória
  • Suporta todos os protocolos de memória

Acessibilidade
  • Acessível através do software Quartus Prime (Ferramentas > ferramentas de depuração de sistema > kit de ferramentas de interface de memória externa)
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Script de execução de comando de caixa de correio

Instruções passo a passo:

Descrição de dispositivo suportada por tópico
Script de caixa de correio de interfaces de memória externa (EMIF)

Dispositivo Agilex™ 7 série M

Dispositivo Agilex™ 5

O Script de acesso da caixa de correio disponível para permitir que você teste a execução do comando.

Para obter instruções passo a passo sobre como realizar o acesso à Caixa de correio, consulte o seguinte guia do usuário:
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Otimização do desempenho do controlador

Para obter informações sobre desempenho e eficiência do controlador, consulte a seguinte seção nos Guias do usuário de interfaces de memória externa (EMIF) de propriedade intelectual (IP).

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

Stratix® 10 dispositivo

Arria® 10 dispositivo

Cyclone® 10 dispositivo
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Recursos adicionais de depuração EMIF

Descrição de dispositivo suportada por tópico
Guia do usuário de Gerador de tráfego 2.0 Dispositivos Agilex™ 7 série F e série I O Gerador de tráfego 2.0 permite que você teste e depure sua interface de memória externa por meio de padrões personalizáveis de tráfego e teste. Consulte o guia e os vídeos a seguir para obter informações detalhadas sobre como usar o recurso Gerador de tráfego 2.0.
Vídeo de gerador de tráfego de exemplo EMIF Arria® 10 dispositivo Saiba como implementar diferentes padrões de teste no gerador de tráfego Arria 10 para interface de memória externa.
Guia do usuário de depuração de várias interfaces de memória Arria® 10 dispositivo Para obter instruções passo a passo sobre como conectar várias interfaces de memória para compatibilidade com o kit de ferramentas de depuração EMIF, consulte o guia do usuário a seguir.
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6. Cursos de treinamento

Dispositivo Agilex™ 7

Séries F e I

 Stratix® 10 dispositivo

Arria® 10 dispositivo

Cyclone® 10 dispositivo
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Guias de usuário adicionais recomendados

Para obter informações sobre a propriedade intelectual (IP) de interface de memória externa (EMIF), consulte os seguintes Guias do usuário emIF IP.

Dispositivo Agilex™ 7

Séries F e I

Dispositivo Agilex™ 7

Série M

 Dispositivo Stratix® 10 do Dispositivo Agilex™ 5

Arria® 10 dispositivo

Cyclone® 10 dispositivo
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Como aprender sobre problemas conhecidos referentes à EMIF

Para obter informações sobre problemas atuais e conhecidos relacionados ao EMIF IP, consulte a base de conhecimento:

Documentação adicional

Lista abrangente de FPGA dispositivos e coleções de produtos, categorizadas pelos estágios do ciclo de vida do produto.

Cursos de treinamento adicionais para interfaces de memória externa

Para obter informações adicionais, pesquise os seguintes recursos: documentação, cursos de treinamento, vídeos, exemplos de designs e base de conhecimentos.

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